일반적으로 TFT(thin film transistor)의 유전체막으로 실리콘 질화막(Si3N4)이나 실리콘 산화막(SiO2)을 200-300˚C의 온도에서 증착을 하게 되는데 본 연구에서는 비정질 실리콘과 유전체막 사이의 계면 특성 특히 계면의 거칠기를 향상시키기 위해서 기존의 증착법이 아니라 비정질 실리콘(a-Si:H)과 산소 ECR 플라즈마의 반응에 의한 산화 막의 성장법을 시도했는데, 이때 기판은 의도적으로 가열하지 않았으며 특히 본 연구에서는 기존의 시도와는 달리 ECR 플라즈마를 형성할 때 마이크로파 전력에 pulse를 가하는 방법을 최초로 시도했고, 계면에 불순물의 혼입을 최대한으로 줄이기 위해서 진공을 파괴하지 않은 상태로 산화막을 연속적으로 성장시키는 방법을 이용했다. Pulse를 가했을 경우에는 pulse를 가하지 않은 경우에 비해서 화학양론적 측면, 유전상수, 산화막의 표면 평탄도 등에서 우수한 산화막이 성장했으며, 특히 비정질 실리콘과 유전체막 사이의 계면 특성을 반영하는 산화막의 표면 평탄도가 1/3정도로 획기적으로 줄어들었다.

Ta2O5박막은 고유전율의 특성으로 차세대 DRAM캐패시터 물질로 유망받고 있는 물질이다. 본 연구에서는 p-type(100)Si 웨이퍼 위에 열 MOCVD 방법으로 Ta2O5박막을 성장시켰으며 기판온도, 버블러 온도, 반응압력의 조업조건이 미치는 영향을 고찰하엿다. 증착된 박막은 SEM, XRD, XPS, FT-IR, AES, TEM, AFM을 이용하여 분석하였으며 질소나 산소 분위기의 furnace 열처리 (FA)와 RTA(Rapid Thermal Annealing)를 통하여 열처리 효과를 살펴보았다. 반응온도에 따른 증착속도는 300 ~ 400 ˚C 범위에서 18.46kcal/mol의 활성화 에너지를 가지는 표면반응 율속단계와 400 ~ 450˚C 범위에서 1.9kcal/mol의 활성화 에너지를 가지는 물질전단 율속단계로 구분되었다. 버블러 온도는 140˚C일때 최대의 증착속도를 보였다. 반응압력에 따른 증착속도는 3torr에서 최대의 증착속도를 보였으나 굴절율은 0.1-1torr사이에 Ta2O5의 bulk값과 비슷한 2.1정도의 양호한 값이 얻어졌다. 400˚C에서 층덮힘은 85.71%로 매우 양호하게 나타났으며 몬테카를로법에 의한 전산모사 결과와의 비교에 의해서 부착계수는 0.06으로 나타났다. FT-IR, AES, TEM 분석결과에 의하여 Si와 Ta2O5 박막 계면의 산화막 두께는 FA-O2 > RTA-O2 ~ FA-N2 > RTA-N2 순으로 성장하였다. 하지만 질소분위기에서 열처리한 박막은 산소분위기의 열처리경우에 비해 박막내의 산소성분의 부족으로 인한 그레인 사이의 결함이 많이 관찰되었다.